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发明专利:876实用新型: 16外观设计: 7
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1:[发明] 机载LRU液冷源
申请号:201710022495.1 公开号:CN106714519A 主分类号:H05K7/20(2006.01)I
申请人:西南电子技术研究所(中国电子科技集团公司第十研究所) 申请日:2017.01.12 公开日:2017.05.24
发明人:张荣;胡家渝;吕倩
摘要:本发明公开的一种机载LRU液冷源,旨在提供一种满足机载平台严酷的环境条件要求,可同时满足多路负载散热需要的液冷源。本发明通过下述技术方案予以实现:分汇流组件分为汇流腔和分流腔两个不同的腔,且在汇流腔上部设有供空气膨胀用的空气腔,空气腔底部设有能为飞机各种飞行姿态下泵组提供冷却液的漏斗;泵组外部卡箍自带散热齿散热。冷却液经过分汇流组件流入汇流腔汇流,汇流冷却液通过管路组件进入过滤器进行过滤,再通过散热组件进行散热,再进入泵组,流向上述分流腔进行分流,将冷却后的冷却液输出,完成一次冷却液的换热过程。本发明无需
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申请号:201710048179.1 公开号:CN106877887A 主分类号:H04B1/00(2006.01)I
申请人:西南电子技术研究所(中国电子科技集团公司第十研究所) 申请日:2017.01.20 公开日:2017.06.20
发明人:李召飞
摘要:本发明提出的一种多站异频信号应答接收系统,旨在提供一种单点驻留时间短、适应点频数多、可靠性高的多站异频接收应答系统,以克服多点频之间的互调干扰。本发明通过下述技术方案予以实现:系统接收不同频点射频信号后,数字信号处理单元发送默认频点至本振信号产生器,将接收到的射频信号与本振信号产生器输出的本振信号在混频器内进行混频,将混频后输出的固定中频送入数字信号处理单元,数字信号处理单元采样固定中频信号并将采样数据送至FPGA内载波环,搜索并完成基于预定多频点扫频和载波锁定及跟踪处理,采用自动驻留的多点频轮询算法判决,给出载波环锁定判决指示,根据算法判决指示改变本振频率,完成载波锁定自动驻留的多站异频信号接收。
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申请号:201710051434.8 公开号:CN106911381A 主分类号:H04B10/11(2013.01)I
申请人:西南电子技术研究所(中国电子科技集团公司第十研究所) 申请日:2017.01.20 公开日:2017.06.30
发明人:杨海峰
摘要:本发明公开了一种激光链路通信测量复合系统,利用本发明能降低有效载荷重量、体积和功耗。本发明通过下述技术方案予以实现:光学天线将综合光信号通过发射端的目镜送入快反镜,反射光通过分束镜将综合光信号的光束分束成两路,一路经过分束镜透射入分束镜将光束透射入粗跟踪模块提取目标位置粗脱靶量,并根据内置控制算法对二维转台施加控制电压;另一路综合光信号通过分束镜将目标引入精跟踪模块视场范围内,透射入精跟踪模块提取目标位置精脱靶量,控制精视场光斑的整体偏移,将光斑引入精跟踪视场的中心,获得目标角度信息,将提取的目标位置精脱靶量送入地面/卫星平台综合电子管理与处理模块,完成目标捕获与瞄准功能和建立通信链路。
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申请号:201710048536.4 公开号:CN106886505A 主分类号:G06F15/78(2006.01)I
申请人:西南电子技术研究所(中国电子科技集团公司第十研究所) 申请日:2017.01.20 公开日:2017.06.23
摘要:本发明公开了一种多波形运行的局部动态可重构系统,旨在提供一种能够降低综合化通信系统功耗、复杂度和体积的局部动态可重构系统,本发明通过下述技术方案予以实现:在FPGA中,设置通过FPGA内部总线互联的总线桥接模块和总线译码模块,波形组件加载控制处理器通过总线桥接模块、总线译码模块将需要加载的波形组件容器数据写入挂接在FPGA内部总线挂载接口上的局部重构配置模块;总线译码模块通过挂载接口连接产生不同工作时钟的时钟管理单元CMT和包含有波形组件的各个波形组件容器的网表文件,运用Xilinx公司提供的综合软件将所有网表文件进行综合生成码流文件,并将码流文件转换为二进制数据而获得用于动态加载的波形组件数据。
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申请号:201710048193.1 公开号:CN106695044A 主分类号:B23K1/008(2006.01)I
申请人:西南电子技术研究所(中国电子科技集团公司第十研究所) 申请日:2017.01.20 公开日:2017.05.24
发明人:海洋
摘要:发明公开的一种电子电路组件气密封装接口方法,利用本发明可以解决工程上常用高频插座、高低频电连接器及圆柱头或沉头螺钉的气密封装问题。本发明通过下述技术方案予以实现:根据电子电路组件内的接插件和紧固件的装配接口,首先安装高频插座、绝缘子和对应的高频插座的焊锡环;将上述焊锡环固定在对应的预置焊锡环孔上;再将沉头螺钉和形状记忆合金环分别装配到各自的装配接口内,然后在真空焊接炉内设置同时满足上述器件的焊接曲线,焊接过程中受热形状记忆合金环产生强有力的收缩挤压腔体和挤压沉头螺钉接口位置预留的环形壁,沉头螺钉将微波毫米
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申请号:201710045976.4 公开号:CN106856463A 主分类号:H04L27/152(2006.01)I
申请人:西南电子技术研究所(中国电子科技集团公司第十研究所) 申请日:2017.01.20 公开日:2017.06.16
摘要:本发明公开的一种MSK/GMSK相干解调处理系统,旨在提供一种能够降低MSK/GMSK信号解调算法复杂度,提高信号解调性能的相干解调处理系统,本发明通过下述技术方案予以实现:MSK/GMSK信号解调端通过一个正交解调模块中的两个90°移相器并联两个低通滤波器组成闭环回路,闭环回路输出端通过基带信号同步模块顺次串联后解码信号解调模块和信息变换模块组成MSK/GMSK相干解调系统;基带信号同步模块将得到的MSK/GMSK基带离散复数信号的起始相位补偿到零相位,送入后解码信号解调模块对每个基带符号交替抽取实部值和虚部幅度值,信息变换模块将小于等于0的实数信号变换为比特0,大于0的实数信号变换为比特1得到信息比特数据并输出到后续信息处理中。
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申请号:201710048287.9 公开号:CN106953658A 主分类号:H04B1/40(2015.01)I
申请人:西南电子技术研究所(中国电子科技集团公司第十研究所) 申请日:2017.01.20 公开日:2017.07.14
发明人:周太富;张剑
摘要:本发明公开的一种高集成度有源相控阵收发组件,旨在一种体积小,集成度高的相控阵收发组件。本发明通过下述技术方案予以实现:相控阵T/R组件与和差器通过垂直互联射频印制板集成在一块高频印制板内,形成一个集成和差器的高密度相控阵T/R收发组件,相控阵T/R组件工作在接收模式R时,将每路天线传输过来的射频信号经矢量调制与合成,再经垂直互联射频印制板进行射频信号垂直过渡,最后经和差器将输入射频信号进行矢量叠加,传送给端机使用;T/R组件工作在发射模式T时,将端机传输过来的射频信号经和差器、垂直互联射频印制板与相控阵T/R组件进行矢量调制与放大,传输给天线作为激励源使用。
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申请号:201611057699.0 公开号:CN106998633A 主分类号:H05K5/02(2006.01)I
申请人:西南电子技术研究所(中国电子科技集团公司第十研究所) 申请日:2016.11.26 公开日:2017.08.01
发明人:冷献春
摘要:本发明提出的一种双层LRM集成风冷通用机箱,旨在提供一种具有通用化、组合化,能够提高机箱的散热效能的风冷通用机箱。本发明通过下述技术方案予以实现:矩形箱体框架中部制有插槽及插槽尺寸系列的支撑板(10),支撑板下方设有可现场更换的风源组件模块(7),风源组件模块位于两层现场可更换模块LRM模块的中部,风源组件模块抽屉箱体内设有分为两组独立工作,按矩阵排列的风机,风机对机架进行供风或通过风源组件模块上的环控风接口对机架供风,微控制单元MCU接收每组风机的故障信号;采用风机供风时,冷却风从机架底部进风,顶部出风;采用环控风供风时,冷却风从风源组件模块面板的环控风接口进风,从机架的顶部及底部出风。
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申请号:201611057972.X 公开号:CN106992354A 主分类号:H01Q1/36(2006.01)I
申请人:西南电子技术研究所(中国电子科技集团公司第十研究所) 申请日:2016.11.27 公开日:2017.07.28
发明人:刘熠志;刘小亮
摘要:本发明提出一种拆子阵馈电VICTS卫通天线,旨在提供一种低剖面、高增益、波束扫描角度大,辐射能力强的卫通天线。本发明通过下述技术方案予以实现:上层金属转盘盘面上制有沿径向方向,按线阵玄线等间距排列的空气长槽,每一个空气长槽的分隔体底部制有起阻抗匹配作用的空气缝隙盲槽,下层金属圆盘对应上层金属转盘底面,制有对称直径轴线排布的波导腔体,每个波导腔体作为天线子阵的馈电网络通过腔体内壁馈电线源,从每个腔体左端产生一个在馈电端近似等幅同相的从左往右进行的准TEM波,准TEM波电场从每个波导腔体中流入空气长槽,上层金属转盘将每一个空气长槽作为辐射子阵单元,将每一个辐射单元子阵结合成一个天线辐射入自然空间的大阵列,辐射入自然空间。
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申请号:201611061981.6 公开号:CN106992094A 主分类号:H01H47/00(2006.01)I
申请人:西南电子技术研究所(中国电子科技集团公司第十研究所) 申请日:2016.11.26 公开日:2017.07.28
摘要:本发明提出了一种串并联时序逻辑继电器电路网络,旨在提供一种基于继电器的高可靠电路执行机构,以保证需要指令输出时指令可靠输出,不需要指令输出时指令绝对不能输出。本发明通过下述技术方案予以实现:按接点串联连接的继电器串联电路和由几个继电器接点并联连接构成的并联电路,三路继电器串联电路共端通过输入端a并联连接接收预令,共端通过输出端c并联连接输出动令,并且两组共线通过并联线b输出预令,从而构成至少三路串并联时序逻辑继电器电路网络,在三路串并联时序逻辑继电器电路网络电路中,串并联继电器被分为两组,两组以总并联的方式共线经并联线b输出预令控制信号,通过动令控制输入网络来实现继电器线包的通断电。
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