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申请号:202180099444.3 公开号:CN117999739A 主分类号:H03K5/24
申请人:弗劳恩霍夫应用研究促进协会 申请日:2021.05.20 公开日:2024.05.07
发明人:莱克·费德勒
摘要:一种装置(10)包括比较器电路(12)和时钟生成电路(28)。比较器电路被配置成在第一比较阶段期间将第一输入信号(14‑1)与第二输入信号(14‑2)进行比较,以获得比较结果(18)。此外,将输出信号(22)输出,其中输出信号的波形指示该比较结果。在随后的再生阶段期间,重置比较器电路的至少一部分用于随后的第二比较阶段。比较器电路被配置成接收时钟信号(28out),并且基于时钟信号从第一比较阶段改变到再生阶段。时钟生成电路(28)被配置成接收输出信号(22)或从其导出的信号,并且基于输出信号的波形生成时钟信号,以基于信号波形控制比较器电路从比较阶段到再生阶段。
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